臺(tái)積電宣布研發(fā)2nm工藝，預(yù)計(jì)四年后投產(chǎn)
文章導(dǎo)讀：在科技創(chuàng)新論壇會(huì)議上，臺(tái)積電研發(fā)負(fù)責(zé)人、技術(shù)研究副總經(jīng)理黃漢森除了探討未來半導(dǎo)體工藝延續(xù)到0.1nm的可能之外，還宣布了一個(gè)重要消息——臺(tái)積電已經(jīng)啟動(dòng)2nm工藝研發(fā)，預(yù)計(jì)4年后問世。
在臺(tái)積電目前的工藝規(guī)劃中，7nm工藝去年已經(jīng)量產(chǎn)，7nm+第1次引入EUV極紫外光刻技術(shù)，目前已經(jīng)投入量產(chǎn)，6nm只是7nm的一個(gè)升級(jí)版，明年第1季度將進(jìn)行試產(chǎn)。
5nm全面導(dǎo)入EUV極紫外光刻，已經(jīng)開始風(fēng)險(xiǎn)性試產(chǎn)，明年底之前量產(chǎn)，蘋果A14、AMD五代銳龍(Zen 4都有望采納)，之后還有個(gè)增強(qiáng)版的N5P工藝。
3nm有望在2021年試產(chǎn)、2022年量產(chǎn)。在3nm之后就要進(jìn)入2nm工藝了，實(shí)際上臺(tái)積電今年6月份就宣布研發(fā)2nm工藝了，工廠設(shè)置在位于中國臺(tái)灣新竹的南方科技園，預(yù)計(jì)2024年投入生產(chǎn)。
按照臺(tái)積電給出的指標(biāo)，2nm工藝是一個(gè)重要節(jié)點(diǎn)，Metal Track(金屬單元高度)和3nm一樣維持在5x，同時(shí)Gate Pitch(晶體管柵極間距)縮小到30nm，Metal Pitch(金屬間距)縮小到20nm，相比于3nm都小了23％。
不過臺(tái)積電沒有透露2nm工藝所需要的技術(shù)和材料，性能、功耗等指標(biāo)更是無從談起。
本文來源：快科技
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普樂斯電子9年專注研制等離子清洗機(jī),等離子表面處理設(shè)備,已通過ISO9001質(zhì)量體系和歐盟CE認(rèn)證,為電子、半導(dǎo)體、汽車、yi療等領(lǐng)域的客戶提供清洗,活化,刻蝕,涂覆的等離子表面處理解決方案。如果您想要了解更多關(guān)于產(chǎn)品的詳細(xì)內(nèi)容或在設(shè)備使用中有疑問，歡迎點(diǎn)擊普樂斯的在線客服進(jìn)行咨詢，或者直接撥打全國統(tǒng)一服務(wù)熱線400-816-9009，普樂斯恭候您的來電！
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【本文標(biāo)簽】：臺(tái)積電半導(dǎo)體工藝2nm
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